Tegra194: smmu: add support for backup multiple smmu regs
Tegra194 supports multiple SMMU blocks. This patch adds support to save register values for SMMU0 and SMMU2, before entering the System Suspend state. Change-Id: I3a376cdb606ea057ad7047714717245f9dced5cf Signed-off-by: Pritesh Raithatha <praithatha@nvidia.com>
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8ecc429143
commit
fba54d5568
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@ -270,143 +270,8 @@ static __attribute__((aligned(16))) smmu_regs_t tegra194_smmu_context[] = {
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mc_make_sid_override_cfg(MIU2W),
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mc_make_sid_override_cfg(MIU3R),
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mc_make_sid_override_cfg(MIU3W),
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smmu_make_gnsr0_nsec_cfg(CR0),
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smmu_make_gnsr0_sec_cfg(IDR0),
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smmu_make_gnsr0_sec_cfg(IDR1),
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smmu_make_gnsr0_sec_cfg(IDR2),
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smmu_make_gnsr0_nsec_cfg(GFSR),
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smmu_make_gnsr0_nsec_cfg(GFSYNR0),
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smmu_make_gnsr0_nsec_cfg(GFSYNR1),
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smmu_make_gnsr0_nsec_cfg(TLBGSTATUS),
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smmu_make_gnsr0_nsec_cfg(PIDR2),
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smmu_make_smrg_group(0),
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smmu_make_smrg_group(1),
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smmu_make_smrg_group(2),
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smmu_make_smrg_group(3),
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smmu_make_smrg_group(4),
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smmu_make_smrg_group(5),
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smmu_make_smrg_group(6),
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smmu_make_smrg_group(7),
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smmu_make_smrg_group(8),
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smmu_make_smrg_group(9),
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smmu_make_smrg_group(10),
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smmu_make_smrg_group(11),
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smmu_make_smrg_group(12),
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smmu_make_smrg_group(13),
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smmu_make_smrg_group(14),
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smmu_make_smrg_group(15),
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smmu_make_smrg_group(16),
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smmu_make_smrg_group(17),
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smmu_make_smrg_group(18),
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smmu_make_smrg_group(19),
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smmu_make_smrg_group(20),
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smmu_make_smrg_group(21),
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smmu_make_smrg_group(22),
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smmu_make_smrg_group(23),
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smmu_make_smrg_group(24),
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smmu_make_smrg_group(25),
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smmu_make_smrg_group(26),
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smmu_make_smrg_group(27),
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smmu_make_smrg_group(28),
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smmu_make_smrg_group(29),
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smmu_make_smrg_group(30),
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smmu_make_smrg_group(31),
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smmu_make_smrg_group(32),
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smmu_make_smrg_group(33),
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smmu_make_smrg_group(34),
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smmu_make_smrg_group(36),
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smmu_make_smrg_group(37),
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smmu_make_smrg_group(38),
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smmu_make_smrg_group(39),
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smmu_make_smrg_group(42),
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smmu_make_smrg_group(43),
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smmu_make_smrg_group(44),
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smmu_make_smrg_group(45),
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smmu_make_smrg_group(46),
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smmu_make_smrg_group(47),
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smmu_make_smrg_group(48),
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smmu_make_smrg_group(49),
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smmu_make_smrg_group(50),
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smmu_make_smrg_group(51),
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smmu_make_smrg_group(52),
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smmu_make_smrg_group(53),
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smmu_make_smrg_group(54),
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smmu_make_smrg_group(55),
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smmu_make_smrg_group(56),
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smmu_make_smrg_group(57),
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smmu_make_smrg_group(58),
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smmu_make_smrg_group(59),
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smmu_make_smrg_group(60),
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||||
smmu_make_smrg_group(61),
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smmu_make_smrg_group(62),
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smmu_make_smrg_group(63),
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smmu_make_cb_group(0),
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smmu_make_cb_group(1),
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smmu_make_cb_group(2),
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smmu_make_cb_group(3),
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smmu_make_cb_group(4),
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smmu_make_cb_group(5),
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smmu_make_cb_group(6),
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smmu_make_cb_group(7),
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smmu_make_cb_group(8),
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smmu_make_cb_group(9),
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smmu_make_cb_group(10),
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smmu_make_cb_group(11),
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smmu_make_cb_group(12),
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smmu_make_cb_group(13),
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smmu_make_cb_group(14),
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smmu_make_cb_group(15),
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smmu_make_cb_group(16),
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smmu_make_cb_group(17),
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smmu_make_cb_group(18),
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smmu_make_cb_group(19),
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smmu_make_cb_group(20),
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smmu_make_cb_group(21),
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smmu_make_cb_group(22),
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smmu_make_cb_group(23),
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smmu_make_cb_group(24),
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smmu_make_cb_group(25),
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||||
smmu_make_cb_group(26),
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smmu_make_cb_group(27),
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smmu_make_cb_group(28),
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smmu_make_cb_group(29),
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smmu_make_cb_group(30),
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smmu_make_cb_group(31),
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smmu_make_cb_group(32),
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smmu_make_cb_group(33),
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smmu_make_cb_group(34),
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smmu_make_cb_group(35),
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smmu_make_cb_group(36),
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smmu_make_cb_group(37),
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smmu_make_cb_group(38),
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smmu_make_cb_group(39),
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smmu_make_cb_group(40),
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smmu_make_cb_group(41),
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smmu_make_cb_group(42),
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smmu_make_cb_group(43),
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smmu_make_cb_group(44),
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smmu_make_cb_group(45),
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smmu_make_cb_group(46),
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smmu_make_cb_group(47),
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smmu_make_cb_group(48),
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smmu_make_cb_group(49),
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smmu_make_cb_group(50),
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smmu_make_cb_group(51),
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smmu_make_cb_group(52),
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smmu_make_cb_group(53),
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smmu_make_cb_group(54),
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smmu_make_cb_group(55),
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smmu_make_cb_group(56),
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smmu_make_cb_group(58),
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smmu_make_cb_group(59),
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smmu_make_cb_group(60),
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smmu_make_cb_group(61),
|
||||
smmu_make_cb_group(62),
|
||||
smmu_make_cb_group(63),
|
||||
smmu_make_cfg(TEGRA_SMMU0_BASE),
|
||||
smmu_make_cfg(TEGRA_SMMU2_BASE),
|
||||
smmu_bypass_cfg, /* TBU settings */
|
||||
_END_OF_TABLE_,
|
||||
};
|
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@ -12,7 +12,7 @@
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#define TEGRA194_STATE_SYSTEM_SUSPEND 0x5C7
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#define TEGRA194_STATE_SYSTEM_RESUME 0x600D
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#define TEGRA194_SMMU_CTX_SIZE 0x490
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#define TEGRA194_SMMU_CTX_SIZE 0x80B
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.align 4
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.globl tegra194_cpu_reset_handler
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